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Description
- Implementar el módulo y el testbench del banco de registros vectorial.
- Archivo fuente:
processor/hdl/generic_blocks_vector/vector_register_file.sv - Archivo test:
processor/tests/geo/vector_register_file_test.sv
Código de Referencia: https://github.com/fmurillom/Proyecto_2_Arqui_2_SIMD/blob/master/SystemVerilog/BancoRegistrosV.sv
Consulta (p40): https://dl.acm.org/doi/10.1145/2912884
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