From 012e6fdb07903f5398acd55b19e0ad38817f803d Mon Sep 17 00:00:00 2001 From: "Wang, Elvin" Date: Mon, 5 May 2025 13:20:27 -0700 Subject: [PATCH] [llvm][CodeGen] Add value types `v5f16` and `v5i16` --- llvm/include/llvm/CodeGen/ValueTypes.td | 410 ++++++++++++------------ 1 file changed, 206 insertions(+), 204 deletions(-) diff --git a/llvm/include/llvm/CodeGen/ValueTypes.td b/llvm/include/llvm/CodeGen/ValueTypes.td index 28216a7a55398..1f621ea586b47 100644 --- a/llvm/include/llvm/CodeGen/ValueTypes.td +++ b/llvm/include/llvm/CodeGen/ValueTypes.td @@ -125,220 +125,222 @@ def v1i16 : VTVec<1, i16, 46>; // 1 x i16 vector value def v2i16 : VTVec<2, i16, 47>; // 2 x i16 vector value def v3i16 : VTVec<3, i16, 48>; // 3 x i16 vector value def v4i16 : VTVec<4, i16, 49>; // 4 x i16 vector value -def v8i16 : VTVec<8, i16, 50>; // 8 x i16 vector value -def v16i16 : VTVec<16, i16, 51>; // 16 x i16 vector value -def v32i16 : VTVec<32, i16, 52>; // 32 x i16 vector value -def v64i16 : VTVec<64, i16, 53>; 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// 128 x bf16 vector value + +def v1f32 : VTVec<1, f32, 110>; // 1 x f32 vector value +def v2f32 : VTVec<2, f32, 111>; // 2 x f32 vector value +def v3f32 : VTVec<3, f32, 112>; // 3 x f32 vector value +def v4f32 : VTVec<4, f32, 113>; // 4 x f32 vector value +def v5f32 : VTVec<5, f32, 114>; // 5 x f32 vector value +def v6f32 : VTVec<6, f32, 115>; // 6 x f32 vector value +def v7f32 : VTVec<7, f32, 116>; // 7 x f32 vector value +def v8f32 : VTVec<8, f32, 117>; // 8 x f32 vector value +def v9f32 : VTVec<9, f32, 118>; // 9 x f32 vector value +def v10f32 : VTVec<10, f32, 119>; // 10 x f32 vector value +def v11f32 : VTVec<11, f32, 120>; // 11 x f32 vector value +def v12f32 : VTVec<12, f32, 121>; // 12 x f32 vector value +def v16f32 : VTVec<16, f32, 122>; // 16 x f32 vector value +def v32f32 : VTVec<32, f32, 123>; // 32 x f32 vector value +def v64f32 : VTVec<64, f32, 124>; // 64 x f32 vector value +def v128f32 : VTVec<128, f32, 125>; // 128 x f32 vector value +def v256f32 : VTVec<256, f32, 126>; // 256 x f32 vector value +def v512f32 : VTVec<512, f32, 127>; // 512 x f32 vector value +def v1024f32 : VTVec<1024, f32, 128>; // 1024 x f32 vector value +def v2048f32 : VTVec<2048, f32, 129>; // 2048 x f32 vector value + +def v1f64 : VTVec<1, f64, 130>; // 1 x f64 vector value +def v2f64 : VTVec<2, f64, 131>; // 2 x f64 vector value +def v3f64 : VTVec<3, f64, 132>; // 3 x f64 vector value +def v4f64 : VTVec<4, f64, 133>; // 4 x f64 vector value +def v8f64 : VTVec<8, f64, 134>; // 8 x f64 vector value +def v16f64 : VTVec<16, f64, 135>; // 16 x f64 vector value +def v32f64 : VTVec<32, f64, 136>; // 32 x f64 vector value +def v64f64 : VTVec<64, f64, 137>; // 64 x f64 vector value +def v128f64 : VTVec<128, f64, 138>; // 128 x f64 vector value +def v256f64 : VTVec<256, f64, 139>; // 256 x f64 vector value + +def nxv1i1 : VTScalableVec<1, i1, 140>; // n x 1 x i1 vector value +def nxv2i1 : VTScalableVec<2, i1, 141>; // n x 2 x i1 vector value +def nxv4i1 : VTScalableVec<4, i1, 142>; // n x 4 x i1 vector value +def nxv8i1 : VTScalableVec<8, i1, 143>; // n x 8 x i1 vector value +def nxv16i1 : VTScalableVec<16, i1, 144>; // n x 16 x i1 vector value +def nxv32i1 : VTScalableVec<32, i1, 145>; // n x 32 x i1 vector value +def nxv64i1 : VTScalableVec<64, i1, 146>; // n x 64 x i1 vector value + +def nxv1i8 : VTScalableVec<1, i8, 147>; // n x 1 x i8 vector value +def nxv2i8 : VTScalableVec<2, i8, 148>; // n x 2 x i8 vector value +def nxv4i8 : VTScalableVec<4, i8, 149>; // n x 4 x i8 vector value +def nxv8i8 : VTScalableVec<8, i8, 150>; // n x 8 x i8 vector value +def nxv16i8 : VTScalableVec<16, i8, 151>; // n x 16 x i8 vector value +def nxv32i8 : VTScalableVec<32, i8, 152>; // n x 32 x i8 vector value +def nxv64i8 : VTScalableVec<64, i8, 153>; // n x 64 x i8 vector value + +def nxv1i16 : VTScalableVec<1, i16, 154>; // n x 1 x i16 vector value +def nxv2i16 : VTScalableVec<2, i16, 155>; // n x 2 x i16 vector value +def nxv4i16 : VTScalableVec<4, i16, 156>; // n x 4 x i16 vector value +def nxv8i16 : VTScalableVec<8, i16, 157>; // n x 8 x i16 vector value +def nxv16i16 : VTScalableVec<16, i16, 158>; // n x 16 x i16 vector value +def nxv32i16 : VTScalableVec<32, i16, 159>; // n x 32 x i16 vector value + +def nxv1i32 : VTScalableVec<1, i32, 160>; // n x 1 x i32 vector value +def nxv2i32 : VTScalableVec<2, i32, 161>; // n x 2 x i32 vector value +def nxv4i32 : VTScalableVec<4, i32, 162>; // n x 4 x i32 vector value +def nxv8i32 : VTScalableVec<8, i32, 163>; // n x 8 x i32 vector value +def nxv16i32 : VTScalableVec<16, i32, 164>; // n x 16 x i32 vector value +def nxv32i32 : VTScalableVec<32, i32, 165>; // n x 32 x i32 vector value + +def nxv1i64 : VTScalableVec<1, i64, 166>; // n x 1 x i64 vector value +def nxv2i64 : VTScalableVec<2, i64, 167>; // n x 2 x i64 vector value +def nxv4i64 : VTScalableVec<4, i64, 168>; // n x 4 x i64 vector value +def nxv8i64 : VTScalableVec<8, i64, 169>; // n x 8 x i64 vector value +def nxv16i64 : VTScalableVec<16, i64, 170>; // n x 16 x i64 vector value +def nxv32i64 : VTScalableVec<32, i64, 171>; // n x 32 x i64 vector value + +def nxv1f16 : VTScalableVec<1, f16, 172>; // n x 1 x f16 vector value +def nxv2f16 : VTScalableVec<2, f16, 173>; // n x 2 x f16 vector value +def nxv4f16 : VTScalableVec<4, f16, 174>; // n x 4 x f16 vector value +def nxv8f16 : VTScalableVec<8, f16, 175>; // n x 8 x f16 vector value +def nxv16f16 : VTScalableVec<16, f16, 176>; // n x 16 x f16 vector value +def nxv32f16 : VTScalableVec<32, f16, 177>; // n x 32 x f16 vector value + +def nxv1bf16 : VTScalableVec<1, bf16, 178>; // n x 1 x bf16 vector value +def nxv2bf16 : VTScalableVec<2, bf16, 179>; // n x 2 x bf16 vector value +def nxv4bf16 : VTScalableVec<4, bf16, 180>; // n x 4 x bf16 vector value +def nxv8bf16 : VTScalableVec<8, bf16, 181>; // n x 8 x bf16 vector value +def nxv16bf16 : VTScalableVec<16, bf16, 182>; // n x 16 x bf16 vector value +def nxv32bf16 : VTScalableVec<32, bf16, 183>; // n x 32 x bf16 vector value + +def nxv1f32 : VTScalableVec<1, f32, 184>; // n x 1 x f32 vector value +def nxv2f32 : VTScalableVec<2, f32, 185>; // n x 2 x f32 vector value +def nxv4f32 : VTScalableVec<4, f32, 186>; // n x 4 x f32 vector value +def nxv8f32 : VTScalableVec<8, f32, 187>; // n x 8 x f32 vector value +def nxv16f32 : VTScalableVec<16, f32, 188>; // n x 16 x f32 vector value + +def nxv1f64 : VTScalableVec<1, f64, 189>; // n x 1 x f64 vector value +def nxv2f64 : VTScalableVec<2, f64, 190>; // n x 2 x f64 vector value +def nxv4f64 : VTScalableVec<4, f64, 191>; // n x 4 x f64 vector value +def nxv8f64 : VTScalableVec<8, f64, 192>; // n x 8 x f64 vector value // Sz = NF * MinNumElts * 8(bits) -def riscv_nxv1i8x2 : VTVecTup<16, 2, i8, 191>; // RISCV vector tuple(min_num_elts=1, nf=2) -def riscv_nxv1i8x3 : VTVecTup<24, 3, i8, 192>; // RISCV vector tuple(min_num_elts=1, nf=3) -def riscv_nxv1i8x4 : VTVecTup<32, 4, i8, 193>; // RISCV vector tuple(min_num_elts=1, nf=4) -def riscv_nxv1i8x5 : VTVecTup<40, 5, i8, 194>; // RISCV vector tuple(min_num_elts=1, nf=5) -def riscv_nxv1i8x6 : VTVecTup<48, 6, i8, 195>; // RISCV vector tuple(min_num_elts=1, nf=6) -def riscv_nxv1i8x7 : VTVecTup<56, 7, i8, 196>; // RISCV vector tuple(min_num_elts=1, nf=7) -def riscv_nxv1i8x8 : VTVecTup<64, 8, i8, 197>; // RISCV vector tuple(min_num_elts=1, nf=8) -def riscv_nxv2i8x2 : VTVecTup<32, 2, i8, 198>; // RISCV vector tuple(min_num_elts=2, nf=2) -def riscv_nxv2i8x3 : VTVecTup<48, 3, i8, 199>; // RISCV vector tuple(min_num_elts=2, nf=3) -def riscv_nxv2i8x4 : VTVecTup<64, 4, i8, 200>; // RISCV vector tuple(min_num_elts=2, nf=4) -def riscv_nxv2i8x5 : VTVecTup<80, 5, i8, 201>; // RISCV vector tuple(min_num_elts=2, nf=5) -def riscv_nxv2i8x6 : VTVecTup<96, 6, i8, 202>; // RISCV vector tuple(min_num_elts=2, nf=6) -def riscv_nxv2i8x7 : VTVecTup<112, 7, i8, 203>; // RISCV vector tuple(min_num_elts=2, nf=7) -def riscv_nxv2i8x8 : VTVecTup<128, 8, i8, 204>; // RISCV vector tuple(min_num_elts=2, nf=8) -def riscv_nxv4i8x2 : VTVecTup<64, 2, i8, 205>; // RISCV vector tuple(min_num_elts=4, nf=2) -def riscv_nxv4i8x3 : VTVecTup<96, 3, i8, 206>; // RISCV vector tuple(min_num_elts=4, nf=3) -def riscv_nxv4i8x4 : VTVecTup<128, 4, i8, 207>; // RISCV vector tuple(min_num_elts=4, nf=4) -def riscv_nxv4i8x5 : VTVecTup<160, 5, i8, 208>; // RISCV vector tuple(min_num_elts=4, nf=5) -def riscv_nxv4i8x6 : VTVecTup<192, 6, i8, 209>; // RISCV vector tuple(min_num_elts=4, nf=6) -def riscv_nxv4i8x7 : VTVecTup<224, 7, i8, 210>; // RISCV vector tuple(min_num_elts=4, nf=7) -def riscv_nxv4i8x8 : VTVecTup<256, 8, i8, 211>; // RISCV vector tuple(min_num_elts=4, nf=8) -def riscv_nxv8i8x2 : VTVecTup<128, 2, i8, 212>; // RISCV vector tuple(min_num_elts=8, nf=2) -def riscv_nxv8i8x3 : VTVecTup<192, 3, i8, 213>; // RISCV vector tuple(min_num_elts=8, nf=3) -def riscv_nxv8i8x4 : VTVecTup<256, 4, i8, 214>; // RISCV vector tuple(min_num_elts=8, nf=4) -def riscv_nxv8i8x5 : VTVecTup<320, 5, i8, 215>; // RISCV vector tuple(min_num_elts=8, nf=5) -def riscv_nxv8i8x6 : VTVecTup<384, 6, i8, 216>; // RISCV vector tuple(min_num_elts=8, nf=6) -def riscv_nxv8i8x7 : VTVecTup<448, 7, i8, 217>; // RISCV vector tuple(min_num_elts=8, nf=7) -def riscv_nxv8i8x8 : VTVecTup<512, 8, i8, 218>; // RISCV vector tuple(min_num_elts=8, nf=8) -def riscv_nxv16i8x2 : VTVecTup<256, 2, i8, 219>; // RISCV vector tuple(min_num_elts=16, nf=2) -def riscv_nxv16i8x3 : VTVecTup<384, 3, i8, 220>; // RISCV vector tuple(min_num_elts=16, nf=3) -def riscv_nxv16i8x4 : VTVecTup<512, 4, i8, 221>; // RISCV vector tuple(min_num_elts=16, nf=4) -def riscv_nxv32i8x2 : VTVecTup<512, 2, i8, 222>; // RISCV vector tuple(min_num_elts=32, nf=2) - -def x86mmx : ValueType<64, 223>; // X86 MMX value -def Glue : ValueType<0, 224>; // Pre-RA sched glue -def isVoid : ValueType<0, 225>; // Produces no value -def untyped : ValueType<8, 226> { // Produces an untyped value +def riscv_nxv1i8x2 : VTVecTup<16, 2, i8, 193>; // RISCV vector tuple(min_num_elts=1, nf=2) +def riscv_nxv1i8x3 : VTVecTup<24, 3, i8, 194>; // RISCV vector tuple(min_num_elts=1, nf=3) +def riscv_nxv1i8x4 : VTVecTup<32, 4, i8, 195>; // RISCV vector tuple(min_num_elts=1, nf=4) +def riscv_nxv1i8x5 : VTVecTup<40, 5, i8, 196>; // RISCV vector tuple(min_num_elts=1, nf=5) +def riscv_nxv1i8x6 : VTVecTup<48, 6, i8, 197>; // RISCV vector tuple(min_num_elts=1, nf=6) +def riscv_nxv1i8x7 : VTVecTup<56, 7, i8, 198>; // RISCV vector tuple(min_num_elts=1, nf=7) +def riscv_nxv1i8x8 : VTVecTup<64, 8, i8, 199>; // RISCV vector tuple(min_num_elts=1, nf=8) +def riscv_nxv2i8x2 : VTVecTup<32, 2, i8, 200>; // RISCV vector tuple(min_num_elts=2, nf=2) +def riscv_nxv2i8x3 : VTVecTup<48, 3, i8, 201>; // RISCV vector tuple(min_num_elts=2, nf=3) +def riscv_nxv2i8x4 : VTVecTup<64, 4, i8, 202>; // RISCV vector tuple(min_num_elts=2, nf=4) +def riscv_nxv2i8x5 : VTVecTup<80, 5, i8, 203>; // RISCV vector tuple(min_num_elts=2, nf=5) +def riscv_nxv2i8x6 : VTVecTup<96, 6, i8, 204>; // RISCV vector tuple(min_num_elts=2, nf=6) +def riscv_nxv2i8x7 : VTVecTup<112, 7, i8, 205>; // RISCV vector tuple(min_num_elts=2, nf=7) +def riscv_nxv2i8x8 : VTVecTup<128, 8, i8, 206>; // RISCV vector tuple(min_num_elts=2, nf=8) +def riscv_nxv4i8x2 : VTVecTup<64, 2, i8, 207>; // RISCV vector tuple(min_num_elts=4, nf=2) +def riscv_nxv4i8x3 : VTVecTup<96, 3, i8, 208>; // RISCV vector tuple(min_num_elts=4, nf=3) +def riscv_nxv4i8x4 : VTVecTup<128, 4, i8, 209>; // RISCV vector tuple(min_num_elts=4, nf=4) +def riscv_nxv4i8x5 : VTVecTup<160, 5, i8, 210>; // RISCV vector tuple(min_num_elts=4, nf=5) +def riscv_nxv4i8x6 : VTVecTup<192, 6, i8, 211>; // RISCV vector tuple(min_num_elts=4, nf=6) +def riscv_nxv4i8x7 : VTVecTup<224, 7, i8, 212>; // RISCV vector tuple(min_num_elts=4, nf=7) +def riscv_nxv4i8x8 : VTVecTup<256, 8, i8, 213>; // RISCV vector tuple(min_num_elts=4, nf=8) +def riscv_nxv8i8x2 : VTVecTup<128, 2, i8, 214>; // RISCV vector tuple(min_num_elts=8, nf=2) +def riscv_nxv8i8x3 : VTVecTup<192, 3, i8, 215>; // RISCV vector tuple(min_num_elts=8, nf=3) +def riscv_nxv8i8x4 : VTVecTup<256, 4, i8, 216>; // RISCV vector tuple(min_num_elts=8, nf=4) +def riscv_nxv8i8x5 : VTVecTup<320, 5, i8, 217>; // RISCV vector tuple(min_num_elts=8, nf=5) +def riscv_nxv8i8x6 : VTVecTup<384, 6, i8, 218>; // RISCV vector tuple(min_num_elts=8, nf=6) +def riscv_nxv8i8x7 : VTVecTup<448, 7, i8, 219>; // RISCV vector tuple(min_num_elts=8, nf=7) +def riscv_nxv8i8x8 : VTVecTup<512, 8, i8, 220>; // RISCV vector tuple(min_num_elts=8, nf=8) +def riscv_nxv16i8x2 : VTVecTup<256, 2, i8, 221>; // RISCV vector tuple(min_num_elts=16, nf=2) +def riscv_nxv16i8x3 : VTVecTup<384, 3, i8, 222>; // RISCV vector tuple(min_num_elts=16, nf=3) +def riscv_nxv16i8x4 : VTVecTup<512, 4, i8, 223>; // RISCV vector tuple(min_num_elts=16, nf=4) +def riscv_nxv32i8x2 : VTVecTup<512, 2, i8, 224>; // RISCV vector tuple(min_num_elts=32, nf=2) + +def x86mmx : ValueType<64, 225>; // X86 MMX value +def Glue : ValueType<0, 226>; // Pre-RA sched glue +def isVoid : ValueType<0, 227>; // Produces no value +def untyped : ValueType<8, 228> { // Produces an untyped value let LLVMName = "Untyped"; } -def funcref : ValueType<0, 227>; // WebAssembly's funcref type -def externref : ValueType<0, 228>; // WebAssembly's externref type -def exnref : ValueType<0, 229>; // WebAssembly's exnref type -def x86amx : ValueType<8192, 230>; // X86 AMX value -def i64x8 : ValueType<512, 231>; // 8 Consecutive GPRs (AArch64) +def funcref : ValueType<0, 229>; // WebAssembly's funcref type +def externref : ValueType<0, 230>; // WebAssembly's externref type +def exnref : ValueType<0, 231>; // WebAssembly's exnref type +def x86amx : ValueType<8192, 232>; // X86 AMX value +def i64x8 : ValueType<512, 233>; // 8 Consecutive GPRs (AArch64) def aarch64svcount - : ValueType<16, 232>; // AArch64 predicate-as-counter -def spirvbuiltin : ValueType<0, 233>; // SPIR-V's builtin type + : ValueType<16, 234>; // AArch64 predicate-as-counter +def spirvbuiltin : ValueType<0, 235>; // SPIR-V's builtin type // AMDGPU buffer fat pointer, buffer rsrc + offset, rewritten before MIR translation. // FIXME: Remove this and the getPointerType() override if MVT::i160 is added. -def amdgpuBufferFatPointer : ValueType<160, 234>; +def amdgpuBufferFatPointer : ValueType<160, 236>; // AMDGPU buffer strided pointer, buffer rsrc + index + offset, doesn't reach MIR. // FIXME: Remove this and the getPointerType() override if MVT::i82 is added. -def amdgpuBufferStridedPointer : ValueType<192, 235>; +def amdgpuBufferStridedPointer : ValueType<192, 237>; -def aarch64mfp8 : ValueType<8, 236>; // 8-bit value in FPR (AArch64) +def aarch64mfp8 : ValueType<8, 238>; // 8-bit value in FPR (AArch64) let isNormalValueType = false in { def token : ValueType<0, 504>; // TokenTy