diff --git a/llvm/include/llvm/CodeGen/ValueTypes.td b/llvm/include/llvm/CodeGen/ValueTypes.td index 300addd7d4daf..65f3c11d09d37 100644 --- a/llvm/include/llvm/CodeGen/ValueTypes.td +++ b/llvm/include/llvm/CodeGen/ValueTypes.td @@ -11,11 +11,12 @@ // //===----------------------------------------------------------------------===// -class ValueType { +class ValueType { string Namespace = "MVT"; string LLVMName = NAME; int Size = size; - int Value = value; + int Value = !if(!ne(value, -1), value, + !add(!size(!instances()), 1)); int nElem = 1; ValueType ElementType = ?; bit isOverloaded = false; @@ -31,21 +32,21 @@ class ValueType { bit isCheriCapability = false; } -class VTAny : ValueType<0, value> { +class VTAny : ValueType<0, value> { let isOverloaded = true; } -class VTInt +class VTInt : ValueType { let isInteger = true; } -class VTFP +class VTFP : ValueType { let isFP = true; } -class VTVec +class VTVec : ValueType { let nElem = nelem; let ElementType = elt; @@ -54,352 +55,352 @@ class VTVec let isVector = true; } -class VTScalableVec +class VTScalableVec : VTVec { let isScalable = true; } -class VTVecTup +class VTVecTup : ValueType { let NF = nf; let ElementType = dummy_elt; let isRISCVVecTuple = true; } -class VTCheriCapability : ValueType { +class VTCheriCapability : ValueType { let isCheriCapability = true; } defset list ValueTypes = { -def OtherVT : ValueType<0, 1> { // "Other" value +def OtherVT : ValueType<0> { // "Other" value let LLVMName = "Other"; } -def i1 : VTInt<1, 2>; // One bit boolean value -def i2 : VTInt<2, 3>; // 2-bit integer value -def i4 : VTInt<4, 4>; // 4-bit integer value -def i8 : VTInt<8, 5>; // 8-bit integer value -def i16 : VTInt<16, 6>; // 16-bit integer value -def i32 : VTInt<32, 7>; // 32-bit integer value -def i64 : VTInt<64, 8>; // 64-bit integer value -def i128 : VTInt<128, 9>; // 128-bit integer value - -def bf16 : VTFP<16, 10>; // 16-bit brain floating point value -def f16 : VTFP<16, 11>; // 16-bit floating point value -def f32 : VTFP<32, 12>; // 32-bit floating point value -def f64 : VTFP<64, 13>; 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// 3 x f16 vector value -def v4f16 : VTVec<4, f16, 103>; // 4 x f16 vector value -def v5f16 : VTVec<5, f16, 104>; // 5 x f16 vector value -def v6f16 : VTVec<6, f16, 105>; // 6 x f16 vector value -def v7f16 : VTVec<7, f16, 106>; // 7 x f16 vector value -def v8f16 : VTVec<8, f16, 107>; // 8 x f16 vector value -def v16f16 : VTVec<16, f16, 108>; // 16 x f16 vector value -def v32f16 : VTVec<32, f16, 109>; // 32 x f16 vector value -def v64f16 : VTVec<64, f16, 110>; // 64 x f16 vector value -def v128f16 : VTVec<128, f16, 111>; // 128 x f16 vector value -def v256f16 : VTVec<256, f16, 112>; // 256 x f16 vector value -def v512f16 : VTVec<512, f16, 113>; // 512 x f16 vector value -def v4096f16 : VTVec<4096, f16, 114>; // 4096 x f16 vector value - -def v1bf16 : VTVec<1, bf16, 115>; // 1 x bf16 vector value -def v2bf16 : VTVec<2, bf16, 116>; // 2 x bf16 vector value -def v3bf16 : VTVec<3, bf16, 117>; // 3 x bf16 vector value -def v4bf16 : VTVec<4, bf16, 118>; // 4 x bf16 vector value -def v8bf16 : VTVec<8, bf16, 119>; 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// RISCV vector tuple(min_num_elts=16, nf=3) -def riscv_nxv16i8x4 : VTVecTup<512, 4, i8, 238>; // RISCV vector tuple(min_num_elts=16, nf=4) -def riscv_nxv32i8x2 : VTVecTup<512, 2, i8, 239>; // RISCV vector tuple(min_num_elts=32, nf=2) - -def x86mmx : ValueType<64, 240>; // X86 MMX value -def Glue : ValueType<0, 241>; // Pre-RA sched glue -def isVoid : ValueType<0, 242>; // Produces no value -def untyped : ValueType<8, 243> { // Produces an untyped value +def riscv_nxv1i8x2 : VTVecTup<16, 2, i8>; // RISCV vector tuple(min_num_elts=1, nf=2) +def riscv_nxv1i8x3 : VTVecTup<24, 3, i8>; // RISCV vector tuple(min_num_elts=1, nf=3) +def riscv_nxv1i8x4 : VTVecTup<32, 4, i8>; // RISCV vector tuple(min_num_elts=1, nf=4) +def riscv_nxv1i8x5 : VTVecTup<40, 5, i8>; // RISCV vector tuple(min_num_elts=1, nf=5) +def riscv_nxv1i8x6 : VTVecTup<48, 6, i8>; // RISCV vector tuple(min_num_elts=1, nf=6) +def riscv_nxv1i8x7 : VTVecTup<56, 7, i8>; // RISCV vector tuple(min_num_elts=1, nf=7) +def riscv_nxv1i8x8 : VTVecTup<64, 8, i8>; // RISCV vector tuple(min_num_elts=1, nf=8) +def riscv_nxv2i8x2 : VTVecTup<32, 2, i8>; // RISCV vector tuple(min_num_elts=2, nf=2) +def riscv_nxv2i8x3 : VTVecTup<48, 3, i8>; // RISCV vector tuple(min_num_elts=2, nf=3) +def riscv_nxv2i8x4 : VTVecTup<64, 4, i8>; // RISCV vector tuple(min_num_elts=2, nf=4) +def riscv_nxv2i8x5 : VTVecTup<80, 5, i8>; // RISCV vector tuple(min_num_elts=2, nf=5) +def riscv_nxv2i8x6 : VTVecTup<96, 6, i8>; // RISCV vector tuple(min_num_elts=2, nf=6) +def riscv_nxv2i8x7 : VTVecTup<112, 7, i8>; // RISCV vector tuple(min_num_elts=2, nf=7) +def riscv_nxv2i8x8 : VTVecTup<128, 8, i8>; // RISCV vector tuple(min_num_elts=2, nf=8) +def riscv_nxv4i8x2 : VTVecTup<64, 2, i8>; // RISCV vector tuple(min_num_elts=4, nf=2) +def riscv_nxv4i8x3 : VTVecTup<96, 3, i8>; // RISCV vector tuple(min_num_elts=4, nf=3) +def riscv_nxv4i8x4 : VTVecTup<128, 4, i8>; // RISCV vector tuple(min_num_elts=4, nf=4) +def riscv_nxv4i8x5 : VTVecTup<160, 5, i8>; // RISCV vector tuple(min_num_elts=4, nf=5) +def riscv_nxv4i8x6 : VTVecTup<192, 6, i8>; // RISCV vector tuple(min_num_elts=4, nf=6) +def riscv_nxv4i8x7 : VTVecTup<224, 7, i8>; // RISCV vector tuple(min_num_elts=4, nf=7) +def riscv_nxv4i8x8 : VTVecTup<256, 8, i8>; // RISCV vector tuple(min_num_elts=4, nf=8) +def riscv_nxv8i8x2 : VTVecTup<128, 2, i8>; // RISCV vector tuple(min_num_elts=8, nf=2) +def riscv_nxv8i8x3 : VTVecTup<192, 3, i8>; // RISCV vector tuple(min_num_elts=8, nf=3) +def riscv_nxv8i8x4 : VTVecTup<256, 4, i8>; // RISCV vector tuple(min_num_elts=8, nf=4) +def riscv_nxv8i8x5 : VTVecTup<320, 5, i8>; // RISCV vector tuple(min_num_elts=8, nf=5) +def riscv_nxv8i8x6 : VTVecTup<384, 6, i8>; // RISCV vector tuple(min_num_elts=8, nf=6) +def riscv_nxv8i8x7 : VTVecTup<448, 7, i8>; // RISCV vector tuple(min_num_elts=8, nf=7) +def riscv_nxv8i8x8 : VTVecTup<512, 8, i8>; // RISCV vector tuple(min_num_elts=8, nf=8) +def riscv_nxv16i8x2 : VTVecTup<256, 2, i8>; // RISCV vector tuple(min_num_elts=16, nf=2) +def riscv_nxv16i8x3 : VTVecTup<384, 3, i8>; // RISCV vector tuple(min_num_elts=16, nf=3) +def riscv_nxv16i8x4 : VTVecTup<512, 4, i8>; // RISCV vector tuple(min_num_elts=16, nf=4) +def riscv_nxv32i8x2 : VTVecTup<512, 2, i8>; // RISCV vector tuple(min_num_elts=32, nf=2) + +def x86mmx : ValueType<64>; // X86 MMX value +def Glue : ValueType<0>; // Pre-RA sched glue +def isVoid : ValueType<0>; // Produces no value +def untyped : ValueType<8> { // Produces an untyped value let LLVMName = "Untyped"; } -def funcref : ValueType<0, 244>; // WebAssembly's funcref type -def externref : ValueType<0, 245>; // WebAssembly's externref type -def exnref : ValueType<0, 246>; // WebAssembly's exnref type -def x86amx : ValueType<8192, 247>; // X86 AMX value -def i64x8 : ValueType<512, 248>; // 8 Consecutive GPRs (AArch64) +def funcref : ValueType<0>; // WebAssembly's funcref type +def externref : ValueType<0>; // WebAssembly's externref type +def exnref : ValueType<0>; // WebAssembly's exnref type +def x86amx : ValueType<8192>; // X86 AMX value +def i64x8 : ValueType<512>; // 8 Consecutive GPRs (AArch64) def aarch64svcount - : ValueType<16, 249>; // AArch64 predicate-as-counter -def spirvbuiltin : ValueType<0, 250>; // SPIR-V's builtin type + : ValueType<16>; // AArch64 predicate-as-counter +def spirvbuiltin : ValueType<0>; // SPIR-V's builtin type // AMDGPU buffer fat pointer, buffer rsrc + offset, rewritten before MIR translation. // FIXME: Remove this and the getPointerType() override if MVT::i160 is added. -def amdgpuBufferFatPointer : ValueType<160, 251>; +def amdgpuBufferFatPointer : ValueType<160>; // AMDGPU buffer strided pointer, buffer rsrc + index + offset, doesn't reach MIR. // FIXME: Remove this and the getPointerType() override if MVT::i82 is added. -def amdgpuBufferStridedPointer : ValueType<192, 252>; +def amdgpuBufferStridedPointer : ValueType<192>; -def aarch64mfp8 : ValueType<8, 253>; // 8-bit value in FPR (AArch64) +def aarch64mfp8 : ValueType<8>; // 8-bit value in FPR (AArch64) // CHERI capabilities. Pointer-like values that carry additional metadata // for enforcing safety guarantees on CHERI-enabled targets. -def c64 : VTCheriCapability<64, 254>; // 64-bit CHERI capability value -def c128 : VTCheriCapability<128, 255>; // 128-bit CHERI capability value +def c64 : VTCheriCapability<64>; // 64-bit CHERI capability value +def c128 : VTCheriCapability<128>; // 128-bit CHERI capability value let isNormalValueType = false in { // Pseudo valuetype mapped to the current CHERI capability pointer size. // Should only be used in TableGen. -def cPTR : VTAny<503>; +def cPTR : VTAny; -def token : ValueType<0, 504>; // TokenTy -def MetadataVT : ValueType<0, 505> { // Metadata +def token : ValueType<0>; // TokenTy +def MetadataVT : ValueType<0> { // Metadata let LLVMName = "Metadata"; } // Pseudo valuetype to represent "pointer to any address space" // Should only be used in TableGen. -def pAny : VTAny<506>; +def pAny : VTAny; // Pseudo valuetype to represent "vector of any size" // Should only be used in TableGen. -def vAny : VTAny<507>; +def vAny : VTAny; // Pseudo valuetype to represent "float of any format" // Should only be used in TableGen. -def fAny : VTAny<508>; +def fAny : VTAny; // Pseudo valuetype to represent "integer of any bit width" // Should only be used in TableGen. -def iAny : VTAny<509>; +def iAny : VTAny; // Pseudo valuetype mapped to the current pointer size. // Should only be used in TableGen. -def iPTR : ValueType<0, 510>; +def iPTR : ValueType<0>; // Pseudo valuetype to represent "any type of any size". // Should only be used in TableGen. -def Any : VTAny<511>; +def Any : VTAny; } // isNormalValueType = false